Análise aprofundada das últimas 72L 3D NAND da SK Hynix

Na memória flash TLC NAND de 72 camadas da SK Hynix, as chamadas unidades P-BiCS (Bit Cost Scalable) em forma de tubo usam uma porta de pipeline para conectar cada string NAND; O layout mostra que o chip contém quatro planos e interruptores / decodificadores de linha de dois lados.

A eficiência da disposição de memória é de cerca de 57%, devido à relativamente grande capacidade de memória e outros periféricos, enquanto matriz de memória Hynix de produtos e 36L 48L eficácia é de 67,5% e 64,0%, respectivamente, esta tendência irá ser apresentada para a próxima geração Hynix O chip desenvolve um design mais compacto.

O 64L 3D TLC NANS da Samsung e Toshiba / WD (Toshiba / Western Digital) possui mais de 65% de eficiência na matriz de memória, no entanto, os tamanhos e funções dos chips de memória acima são similares.

Vários 64L e 72L 3D memória flash NAND matriz de células de eficiência comparativa (Fonte: TechInsights)

densidade de bits Hynix 72L memória flash NAND é de 3,55 Gbits / mm2, superiores a Samsung / WD 64L do chip; fichas Micron / Intel (Micron / Intel) 64L 3D NAND de quatro tipos de soluções é a densidade pouco maior principalmente porque o uso do nome CuA (CMOS sob o array) são tijolo (título) layout exclusivo.

64L e 72L 3D NAND chips de memória comparação bit densidade (Fonte: TechInsights)

Em células arquitectura de memória 3D NAND, chips Hynix empilhamento de um total de 82 portas, incluindo um selector (selector) e a linha de palavra manequim (wordlines manequim, DWL); Sabemos que existe uma porta 72 caracteres activos unidade de linha, o eléctrodo de portão três superior é utilizada para o portão selector de fonte e dreno do pólo (portões selectores, SG), os restantes sete portas deve ser usado e uma DWL portão isolamento (portões de isolamento ).

Nos componentes NAND de 64L de vários fabricantes, vemos:

Samsung total empregue portas 71, dos quais três para SG, 4 th por DWL; eléctrodo de portão total do produto da Toshiba / WD é 73, para sete SG, 2 th por DWL; Micron / produto Intel eléctrodo de porta total de 76, dos quais dois de SG, 7 th por DWL.

O método de cálculo da eficiência da célula vertical é o número de linhas de palavras ativas divididas pelo número total de portais verticais da pilha, resultando na eficiência do processo da arquitetura da célula de memória NAND 3D A eficiência vertical da célula dos produtos SK Hynix 72L é de 87,8% O mesmo vale para os produtos 64L BiCS, a eficiência do produto de 64L da Samsung é de 90,1%, enquanto a eficiência do produto de 64L da Micron / Intel é de 84,2%, conforme mostrado abaixo.

Eficiência de Unidade Vertical de Produtos de Memória NAND 3D de 64L e 72L (Fonte: TechInsights)

Os produtos anteriores 36L e 48L da SK Hynix usam um processo de gravação de etapa única para criar furos de canal para 43 e 55 portas, respectivamente, uma nova geração de células de memória de 72L é produzida usando um processo de gravação em duas etapas. Levar para o buraco No portão da tubulação, as 42 portas inferiores e as 40 portas superiores são formadas em duas etapas de corrosão diferentes. -slits) são formados em uma única etapa de gravação.O procedimento de integração de processo é o seguinte:

Moldagem da porta do duto (parte inferior) Gravura do canal (parte inferior) Furos preenchidos da camada sacrifical; Moldagem (parte superior); Gravura do canal (parte superior); Remoção da camada de sacrifício;

produtos micron / Intel 64L de arquitectura cadeia dupla NAND empilhados, existe uma placa (placa) entre o empilhamento superior e inferior; e produto Hynix 72L é a utilização de um processo de ataque químico de dois passos, em vez de dupla cadeia NAND empilhados, engenheiros deve ser controlada de perto os passos do processo a fim de evitar orifícios de passagem não estão alinhados partes superior e inferior; o tamanho dos orifícios 256 Gbit 72L apenas cerca de 10 nanómetros mais produtos analisados ​​em Hynix 72L memória flash NAND, aperte Link de leitura

Compilação: Judith Cheng

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